【導讀】在上一期的芝識課堂中，我們和大家一起了解了CMOS邏輯IC可(ke)以(yi)分(fen)為(wei)組(zu)合(he)邏(luo)輯(ji)和(he)時(shi)序(xu)邏(luo)輯(ji)，並(bing)以(yi)幾(ji)種(zhong)典(dian)型(xing)電(dian)路(lu)單(dan)元(yuan)的(de)對(dui)應(ying)邏(luo)輯(ji)關(guan)係(xi)詳(xiang)細(xi)解(jie)讀(du)了(le)組(zu)合(he)邏(luo)輯(ji)電(dian)路(lu)的(de)原(yuan)理(li)。這(zhe)一(yi)期(qi)芝(zhi)識(shi)課(ke)堂(tang)中(zhong)
，我(wo)們(men)將(jiang)繼(ji)續(xu)和(he)大(da)家(jia)分(fen)享(xiang)CMOS邏輯IC的基礎知識
，並通過實際電路單元來幫助大家分析組合邏輯和時序邏輯中各自所對應的輸入和輸出之間暗藏的邏輯關係。

多路複用器

多路複用器也是一種典型的組合邏輯電路，比如東芝的74VHC157和74VHC153，多路複用器將從多個輸入信號中選擇一個信號並將其轉發到單個輸出線。圖1所示的時序圖顯示了如何從兩個輸入中選擇一個信號。當選擇引腳為低電平（0）時
，信號從A引腳轉發到Y引腳。當選擇引腳為高電平（1）時，信號從B引腳轉發到Y引腳。

圖1 2對1多路複用器的時序圖

模擬多路複用器／解複用器

與多路複用器類似
，模擬多路複用器／解(jie)複(fu)用(yong)器(qi)作(zuo)為(wei)組(zu)合(he)邏(luo)輯(ji)電(dian)路(lu)，包(bao)含(han)模(mo)擬(ni)開(kai)關(guan)，以(yi)從(cong)多(duo)個(ge)模(mo)擬(ni)輸(shu)入(ru)中(zhong)選(xuan)擇(ze)一(yi)個(ge)信(xin)號(hao)並(bing)將(jiang)其(qi)轉(zhuan)發(fa)到(dao)單(dan)個(ge)輸(shu)出(chu)線(xian)。由(you)於(yu)模(mo)擬(ni)開(kai)關(guan)可(ke)以(yi)雙(shuang)向(xiang)傳(chuan)輸(shu)信(xin)號(hao)，因(yin)此(ci)模(mo)擬(ni)多(duo)路(lu)複(fu)用(yong)器(qi)也(ye)可(ke)用(yong)作(zuo)解(jie)複(fu)用(yong)器(qi)。模(mo)擬(ni)多(duo)路(lu)複(fu)用(yong)器(qi)／解複用器可用於傳輸模擬和數字信號

，典型的產品比如東芝的74VHC4051、74VHC4052和74VHC4053。

模擬開關

在組合邏輯方麵還有一個廣泛應用的電路單元：模擬開關
，比如東芝的74VHC4066。模擬開關可以在任一方向上傳導正弦波信號等模擬信號。它在打開時傳遞信號，在關閉時阻斷信號。模擬開關由一對n溝道和p溝道MOSFET並聯組成，以降低導通電阻，提高I/O線性特性。模擬開關的數據表顯示了典型的正弦波失真
、最大頻率響應
、饋通衰減、串擾和其它模擬開關特性。圖2、圖3和圖4是模擬開關的邏輯符號、真值表、時序圖和邏輯示意圖。

圖2 模擬開關的邏輯符號和真值表

圖3 模擬開關的時序圖

圖4 模擬開關的邏輯示意圖

介紹了多個組合邏輯應用之後，我們再來看看時序邏輯的主要應用電路單元。

鎖存器

首先我們來一起分析一下鎖存器（以東芝的74VHC373為例）。鎖存器可以在特定條件下保留數據。鎖存器有D型和RS（複位和設置）型等類型。下麵將以D型鎖存器為例對操作進行說明。例如，D型鎖存器具有輸入數據引腳（D）
、鎖存器啟用引腳（LE）和輸出數據引腳（Q）。在此例中，當LE為低電平時，Q將保留D的先前值。當LE為高電平時，Q將跟隨D而變化。圖5顯示了D型鎖存器的時序圖。

圖5 D型鎖存器的時序圖

觸發器

觸發器（以東芝的74VHC74為例）是時序邏輯的另一個主要電路單元
，觸發器可以在特定條件下保留數據。“flip-flop”（觸發器）這個詞有時縮寫為FF。觸發器有D型和JK型等類型。下麵將以D型觸發器為例對操作進行說明。

D型觸發器與D型鎖存器的不同之處在於，即使在時鍾設置為無效後（在本例中為低電平）之後
，D型觸發器仍保留輸出數據（當LE輸入為高電平時，D型鎖存器將數據從D輸入端傳輸至Q輸出端）。例如，D型觸發器具有輸入數據引腳（D）、時鍾引腳（CK）和輸出數據引腳（Q）。該觸發器將輸入數據（D）鎖存在CK的上升沿上
，並將其傳輸至Q。無論輸入數據（D）如何，Q均保持不變
，直到CK的下一個上升沿。換句話說，Q將保留鎖存在CK的前一上升沿上的輸入數據（D）。圖6顯示了D型觸發器的時序圖。有些觸發器有一個清除（CLR）或預設（PR）輸入引腳，用於將內部狀態初始化為已知值。觸發器用於異步信號的同步器和數字信號的延遲電路以及計數器、分頻器等。

圖6 D型觸發器的時序圖

我們通過邏輯示意圖（圖7）說明D型觸發器的操作。D型觸發器由兩種D型鎖存器組成。當時鍾的上升沿施加到CK時，D型鎖存器#1被激活。當時鍾（CK）為高電平時，D型鎖存器#1保持激活狀態，因此D型鎖存器#2中的第一個時鍾反相器也處於激活狀態。因此
，D型鎖存器＃1中保存的數據將傳輸到輸出（Q），如藍色箭頭所示。即使輸入更改狀態，輸出也將保持不變。

當時鍾下降沿施加到CK時，D型鎖存器#2被激活。結果
，保存在D型鎖存器＃2中的數據將繼續出現在綠色箭頭高亮顯示的輸出端（Q）。同樣，即使輸入狀態改變，輸出也保持不變。應該注意的是，直到已知輸入在時鍾（CK）的上升沿被鎖存之前
，輸出（Q）的值才是未知的。

圖7 D型觸發器邏輯示意圖

計數器

計數器（東芝74VHC393
，74VHC161）是一種典型的時序邏輯電路單元，計數器在每個時鍾（CK）脈衝上按順序進行遞增或遞減計數。一個4位計數器的模數可達16；一個8位計數器的模數可達256；一個14位計數器的模數可達16384。某些計數器具有CLR輸入，用於將內部狀態初始化為已知值。

計數器集成在數字定時器
、電子計算器、秒表和許多其它設備中。計數器大致分為異步（紋波進位）和同步（並行進位）計數器。設單個觸發器的傳輸延遲時間為tpd。然後，n級異步計數器將產生相當於n×tpd的大延遲。還應注意

，當計數器輸出饋送至邏輯門時，異步計數器可能產生風險。圖8顯示了一個典型的同步（並行進位）計數器的時序圖，它在時鍾（CK）的每一個邊沿上按順序進行遞增計數。

圖8

移位寄存器

移位寄存器（如東芝的74VHC164，74VHC165）可以配置為串行-並行（SI-PO）或並行-串行（PI-SO）轉換。並行-串行轉換有助於減少傳輸線的數量（即傳輸位寬度）。某些移位寄存器具有CLR輸入，用於將內部狀態初始化為已知值。移位寄存器由多個觸發器組成。圖9通過邏輯示意圖和時序圖說明移位寄存器的操作。移位寄存器由級聯觸發器組成

，其中每個觸發器的輸出端（Q）連接至該鏈中下一個觸發器的數據（D）輸入端。串行輸入（SI）施加至第一觸發器的數據（D）輸入端。來自SI的數據在時鍾（CK）的上升沿被鎖存
，並出現在QA處。利用四個時鍾脈衝
，來自SI的數據被傳輸到第四個觸發器。結果
，串行輸入（SI）被轉換為並行輸出數據出現在QD、QC、QB和QA處。

圖9 移位寄存器（串行輸入，並行輸出）的時序圖

本ben期qi芝zhi識shi課ke堂tang中zhong，我wo們men以yi典dian型xing的de幾ji個ge邏luo輯ji電dian路lu單dan元yuan來lai說shuo明ming組zu合he邏luo輯ji和he時shi序xu邏luo輯ji電dian路lu單dan元yuan是shi如ru何he進jin行xing輸shu入ru和he輸shu出chu邏luo輯ji轉zhuan換huan的de，從cong而er了le解jie邏luo輯jiIC的各種基礎邏輯知識
，下期芝識課堂我們將帶大家了解數據讀取的相關知識，感興趣的話千萬不要錯過哦。

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