如何識別和防止7nm工藝失效
發布時間:2020-08-18 責任編輯:lina
【導讀】器(qi)件(jian)的(de)良(liang)率(lv)在(zai)很(hen)大(da)程(cheng)度(du)上(shang)依(yi)賴(lai)於(yu)適(shi)當(dang)的(de)工(gong)藝(yi)規(gui)格(ge)設(she)定(ding)和(he)對(dui)製(zhi)造(zao)環(huan)節(jie)的(de)誤(wu)差(cha)控(kong)製(zhi),在(zai)單(dan)元(yuan)尺(chi)寸(cun)更(geng)小(xiao)的(de)先(xian)進(jin)節(jie)點(dian)上(shang)就(jiu)更(geng)是(shi)如(ru)此(ci)。過(guo)去(qu)為(wei)了(le)識(shi)別(bie)和(he)防(fang)止(zhi)工(gong)藝(yi)失(shi)效(xiao),必(bi)須(xu)要(yao)通(tong)過(guo)大(da)量(liang)晶(jing)圓(yuan)的(de)製(zhi)造(zao)和(he)測(ce)試(shi)來(lai)收(shou)集(ji)數(shu)據(ju),然(ran)後(hou)對(dui)采(cai)集(ji)到(dao)的(de)數(shu)據(ju)進(jin)行(xing)相(xiang)關(guan)性(xing)分(fen)析(xi),整(zheng)個(ge)過(guo)程(cheng)費(fei)時(shi)且(qie)昂(ang)貴(gui)。
通過失效分類、良率預測和工藝窗口優化實現良率預測和提升
器(qi)件(jian)的(de)良(liang)率(lv)在(zai)很(hen)大(da)程(cheng)度(du)上(shang)依(yi)賴(lai)於(yu)適(shi)當(dang)的(de)工(gong)藝(yi)規(gui)格(ge)設(she)定(ding)和(he)對(dui)製(zhi)造(zao)環(huan)節(jie)的(de)誤(wu)差(cha)控(kong)製(zhi),在(zai)單(dan)元(yuan)尺(chi)寸(cun)更(geng)小(xiao)的(de)先(xian)進(jin)節(jie)點(dian)上(shang)就(jiu)更(geng)是(shi)如(ru)此(ci)。過(guo)去(qu)為(wei)了(le)識(shi)別(bie)和(he)防(fang)止(zhi)工(gong)藝(yi)失(shi)效(xiao),必(bi)須(xu)要(yao)通(tong)過(guo)大(da)量(liang)晶(jing)圓(yuan)的(de)製(zhi)造(zao)和(he)測(ce)試(shi)來(lai)收(shou)集(ji)數(shu)據(ju),然(ran)後(hou)對(dui)采(cai)集(ji)到(dao)的(de)數(shu)據(ju)進(jin)行(xing)相(xiang)關(guan)性(xing)分(fen)析(xi),整(zheng)個(ge)過(guo)程(cheng)費(fei)時(shi)且(qie)昂(ang)貴(gui)。如今半導體虛擬製造工具(例如SEMulator3D®)的出現改變了這一現狀,讓我們可以在“虛擬”環huan境jing下xia完wan成cheng以yi上shang實shi驗yan。甚shen至zhi在zai矽gui材cai料liao中zhong進jin行xing工gong藝yi實shi驗yan之zhi前qian,虛xu擬ni製zhi造zao就jiu可ke以yi用yong於yu了le解jie工gong藝yi之zhi間jian的de相xiang互hu影ying響xiang和he工gong藝yi步bu驟zhou靈ling敏min度du以yi實shi現xian最zui大da化hua良liang率lv。本ben文wen將jiang通tong過guo一yi個ge簡jian單dan示shi例li來lai演yan示shi如ru何he通tong過guo虛xu擬ni製zhi造zao來lai提ti升sheng7nm節點特定結構的良率,其中使用到的技術包括失效分類、良率預測和工藝窗口優化。
良率提升與失效分類
A.失效分類定義
邊緣定位誤差是導致後段製程良率損失的主要失效模式[1]。下麵用簡單實例說明,假設M1由金屬A(MA)和金屬B(MB)組成【通常由LELE(光刻-刻蝕-光刻-刻蝕),或自對準雙重圖形化技術(SADP)工藝產生】,而接觸孔(VC)被設計連接到MB。
金屬關鍵尺寸CD(或SADP工藝中的心軸CD)或VCCD或金屬至VC的套準精度存在工藝誤差,會引起因通孔和金屬層之間產生邊緣定位誤差而導致的良率損失。
如下失效分類分別對應不同的CD和套準誤差組合(見圖1):
1.高接觸電阻(HR):VC和MB接觸麵積過小
2.VC-MA漏電(VML):VC至MA的距離過小
3.MA-MB漏電(MML):MA至MB的距離過小
4.VC-MB開路(VMO):VC未接觸MB,兩者之間沒有重疊
5.VC-MA短路(VMS):VC接觸MA,兩者之間有部分重疊

圖1.分類圖示(a)合格,(b)HR,(c)VML,(d)MML,(e)VMO,(f)VMS
B.結構構建與校準,以及失效模式生成與識別
為了演示如何通過虛擬製造提高良率,現構建一個7nm的VC和M1工藝。在生成並校準虛擬工藝結構之後,執行一係列虛擬量測步驟。圖2展示了在虛擬結構上相應的測量位置,根據測量結果,可以將當前失效納入相應的失效分類。

圖2虛擬測量(結構檢索)(a)VA-MA最小接觸麵積,(b)VA-MB最小距離,(c)MA-MB最小距離,(d)VB-MB最大接觸麵積
基於特定的規格和規則,可以根據測量結果自動實現失效模式分類。
C.良率預測和失效模式排行
在實際的製造過程中,心軸/通孔CD和套準精度等工藝參數被控製在以目標值為中心一定寬度的範圍內分布。通過SEMulator3D可自動執行實驗設計(DOE)並生成和收集由用戶定義的平均值和範圍寬度/標準差。根據收集的數據和預先設定的良率規則,即可計算出合格率或良率(即在特定輸入條件下,通過合格次數與檢驗總次數的比率)。用戶還可以根據生成的測量結果與失效規則做對比,對失效進行自定義分類。
我們首先確定了MCD(心軸CD)、VCD(通孔CD)、SPT(側牆厚度)和MVO(軸心-VCX軸方向套準精度)的均值移動範圍及其分布寬度,之後執行實驗設計,用蒙特卡洛模擬方法執行3000次虛擬實驗測試。圖3(a,b)weisizhongbutongshurutiaojianxiadeshixiaoleibiehuizongtiaoxingtuhelianglvhuizongbiao,tongguozhexietubiaokeyikanchutedingshurutiaojianxiafashenggezhongshixiaodegailvdaxiaobingyoucipanduanchugeleishixiaomoshiduilianglvdeyingxiang。

圖3.特定MCD/VCD/MVO條件下的良率情況。(a)失效模式條形圖,(b)良率彙總
D.工藝窗口優化
在zai工gong藝yi開kai發fa過guo程cheng中zhong,開kai展zhan上shang述shu分fen析xi可ke能neng會hui引yin發fa一yi係xi列lie其qi他ta問wen題ti,例li如ru預yu測ce所suo得de的de良liang率lv是shi否fou合he理li?是shi否fou可ke通tong過guo調tiao整zheng規gui格ge均jun值zhi獲huo得de更geng高gao的de良liang率lv?放fang寬kuan工gong藝yi分fen布bu寬kuan度du要yao求qiu的de同tong時shi能neng否fou保bao持chi良liang率lv?如ru果guo無wu法fa達da到dao滿man意yi的de良liang率lv結jie果guo,是shi否fou可ke以yi通tong過guo收shou緊jin分fen布bu寬kuan度du以yi達da到dao目mu標biao良liang率lv,以yi及ji收shou緊jin程cheng度du如ru何he?要yao回hui答da上shang述shu問wen題ti就jiu要yao用yong到daoSEMulator3D中的工藝窗口優化(PWO)功能。該功能可以自動搜索具有固定分布寬度的均值組合,然後再根據所收集的數據得出最高良率(合格率)的最佳工藝窗口。
表1所示為工藝參數優化前,優化後,優化後+收緊SPT厚度條件下的良率及其對應的工藝窗口。通過該表可以看出,隻需優化工藝規格均值即可將良率從48.4%提高至96.6%,接下來隻需進一步收緊SPT分布寬度值即可獲得99%的目標良率。

表1.不同輸入條件下的良率彙總表
結論
本文探討了如何通過虛擬製造提高良率。文中實例采用了因邊緣定位誤差導致VC-M1良率損失的7nm6TSRAM模型,采用的技術包括結構構建、模型校準、虛擬量測、失效分類、良率預測和工藝窗口優化。分析結果表明通過工藝窗口優化功能和收緊規格要求可以將良率從48.4%提高到99.0%。可以看出,虛擬製造可廣泛應用於各種良率提升研究,而這些研究的結果將推動半導體工藝和技術的發展。
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