中心議題：

• 電源係統的電磁幹擾方式
• 電源係統的電磁幹擾類型
• 電源係統的抗幹擾措施
• 電源係統的板級電磁兼容設計

解決方案：

• 去耦電容就像是靠近需求點
• 電源軌道走得越近越好

suizheshishixinhaochulidesulvbuduanjiakuai
，shuzidianluxitongdeshizhongpinlvyesuizhizengjia。tongshi
，bandaotigongyidegaijin，yeshidedianluxitongzhongxinhaobianyansulvtishengdaons級甚至更高的級別。快速的信號邊沿變化使得電路信號產生振鈴、反射
、串擾、地(di)彈(dan)等(deng)許(xu)多(duo)信(xin)號(hao)完(wan)整(zheng)性(xing)問(wen)題(ti)。而(er)且(qie)，這(zhe)個(ge)問(wen)題(ti)越(yue)來(lai)越(yue)嚴(yan)重(zhong)。隨(sui)著(zhe)電(dian)路(lu)中(zhong)器(qi)件(jian)和(he)芯(xin)片(pian)工(gong)作(zuo)環(huan)境(jing)的(de)惡(e)化(hua)，電(dian)源(yuan)受(shou)到(dao)的(de)影(ying)響(xiang)非(fei)常(chang)嚴(yan)重(zhong)
，電(dian)源(yuan)係(xi)統(tong)的(de)電(dian)磁(ci)兼(jian)容(rong)性(xing)設(she)計(ji)變(bian)得(de)更(geng)加(jia)富(fu)有(you)挑(tiao)戰(zhan)性(xing)。研(yan)究(jiu)電(dian)源(yuan)係(xi)統(tong)的(de)電(dian)磁(ci)兼(jian)容(rong)性(xing)設(she)計(ji)非(fei)常(chang)有(you)必(bi)要(yao)而(er)且(qie)非(fei)常(chang)緊(jin)迫(po)。

電磁兼容的相關知識

國家標準GB/T4765—1995《電磁兼容術語》對電磁兼容所下的定義：“設備或係統在其電磁環境中能正常工作且不對該環境中任何事物構成不能承受的電磁騷擾的能力。”

1電源係統的電磁幹擾方式

電源幹擾的複雜性原因之一是包含了許多可變的因素。首先，電源幹擾可以以“共模”或“差模”方式存在，這是根據電磁幹擾噪聲對於電路作用的形態來進行劃分的，如圖1所suo示shi。任ren何he電dian路lu中zhong都dou存cun在zai共gong模mo和he差cha模mo電dian流liu。共gong模mo和he差cha模mo電dian流liu決jue定ding了le傳chuan播bo的de電dian磁ci能neng量liang的de大da小xiao。如ru果guo給gei定ding一yi對dui導dao線xian，一yi個ge返fan回hui參can考kao平ping麵mian，那na麼me這zhe兩liang種zhong模mo式shi中zhong至zhi少shao有you一yi種zhong將jiang會hui存cun在zai
，但dan通tong常chang是shi共gong存cun。一yi般ban來lai說shuo

，差cha模mo信xin號hao攜xie帶dai數shu據ju或huo有you用yong信xin息xi，而er共gong模mo信xin號hao是shi差cha模mo信xin號hao的de負fu麵mian效xiao果guo，不bu包bao含han有you用yong信xin息xi
，是shi輻fu射she的de主zhu要yao來lai源yuan，解jie決jue起qi來lai相xiang當dang的de麻ma煩fan。


圖1共模與差模幹擾示意圖

2電源係統的電磁幹擾類型

造成電源幹擾複雜性的第二個原因是幹擾表現的形式很多，從持續期很短的尖峰幹擾直至電網完全失電，其中也包括了電壓的變化（如電壓跌落
、浪湧和中斷）、頻率變化、波形失真（包括電壓和電流的）、持chi續xu噪zao聲sheng或huo雜za波bo
，以yi及ji瞬shun變bian等deng。我wo們men根gen據ju國guo內nei外wai的de抗kang擾rao度du測ce試shi的de一yi係xi列lie標biao準zhun和he實shi際ji應ying用yong中zhong常chang常chang出chu現xian的de問wen題ti

，總zong結jie了le電dian源yuan幹gan擾rao的de常chang見jian起qi因yin，如ru表biao1所示。


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3電磁幹擾的途徑

從cong電dian磁ci兼jian容rong標biao準zhun來lai說shuo，電dian磁ci幹gan擾rao基ji本ben上shang被bei分fen成cheng傳chuan導dao噪zao聲sheng和he輻fu射she噪zao聲sheng。這zhe也ye是shi一yi種zhong直zhi觀guan分fen類lei
，一yi種zhong是shi接jie觸chu性xing的de幹gan擾rao
，一yi種zhong是shi非fei接jie觸chu性xing。電dian磁ci幹gan擾rao就jiu其qi實shi際ji作zuo用yong於yu電dian路lu的de機ji理li有you四si種zhong傳chuan輸shu方fang式shi：傳導耦合
，電磁場耦合，磁場耦合和電場耦合，如圖2所示。


圖2耦合方式

抗幹擾措施

因為直流穩壓電源既是一個敏感器件也是一個噪聲源，因此我們就有如下的濾波策略：一(yi)個(ge)是(shi)對(dui)電(dian)源(yuan)係(xi)統(tong)的(de)前(qian)端(duan)入(ru)口(kou)處(chu)進(jin)行(xing)濾(lv)波(bo)。因(yin)為(wei)外(wai)界(jie)對(dui)電(dian)源(yuan)係(xi)統(tong)的(de)影(ying)響(xiang)基(ji)本(ben)上(shang)都(dou)是(shi)通(tong)過(guo)入(ru)口(kou)的(de)電(dian)源(yuan)線(xian)引(yin)入(ru)到(dao)電(dian)源(yuan)係(xi)統(tong)中(zhong)的(de)。無(wu)論(lun)是(shi)傳(chuan)導(dao)噪(zao)聲(sheng)，還(hai)是(shi)輻(fu)射(she)噪(zao)聲(sheng)都(dou)是(shi)會(hui)耦(ou)合(he)到(dao)電(dian)源(yuan)線(xian)上(shang)。因(yin)此(ci)，該(gai)處(chu)的(de)濾(lv)波(bo)要(yao)精(jing)心(xin)處(chu)理(li)。二(er)是(shi)電(dian)源(yuan)係(xi)統(tong)的(de)出(chu)口(kou)，一(yi)般(ban)來(lai)說(shuo)，這(zhe)裏(li)不(bu)應(ying)該(gai)有(you)太(tai)多(duo)問(wen)題(ti)，因(yin)為(wei)我(wo)們(men)選(xuan)擇(ze)和(he)設(she)計(ji)電(dian)源(yuan)時(shi)，都(dou)要(yao)基(ji)於(yu)一(yi)定(ding)的(de)參(can)數(shu)和(he)性(xing)能(neng)指(zhi)標(biao)。但(dan)是(shi)為(wei)了(le)解(jie)如(ru)何(he)能(neng)夠(gou)達(da)到(dao)最(zui)佳(jia)的(de)電(dian)源(yuan)性(xing)能(neng)，需(xu)要(yao)考(kao)慮(lv)出(chu)口(kou)的(de)濾(lv)波(bo)性(xing)能(neng)。

如圖3所示是對所有可能噪聲幹擾路徑的噪聲抑製的方法。這就分成兩種方法，一種是EMI濾lv波bo器qi，一yi種zhong是shi屏ping蔽bi。屏ping蔽bi更geng多duo是shi涉she及ji到dao機ji殼ke整zheng體ti的de機ji械xie結jie構gou設she計ji
，往wang往wang對dui係xi統tong的de布bu局ju布bu置zhi有you更geng多duo考kao慮lv。從cong電dian路lu設she計ji的de角jiao度du
，我wo們men更geng多duo的de是shi要yao考kao慮lvEMI濾波器。因為更為廣泛的幹擾都是從線路上溢出或是從線路上的耦合中產生的
，因此在線路上的濾波對輻射的抑製效果更明顯一點。


圖3抗幹擾措施

電源係統的板級電磁兼容設計

在電源設計中的一個重要環節就是電源係統的板級電路設計問題，這也是從電源技術的選擇、電源架構的搭建、電源器件的定型，以及電源濾波的設計等一係列的概念設計（原理設計）問題走向了最終的物理實現（PCB設計）的過程。

在設計數字電路係統中，我們要通過電源分配係統（PowerDistributionSystem）達到兩個基本的目的：為數字信號轉換提供穩定的電壓參考，為所有邏輯器件分配電源。

在zai實shi際ji的de電dian路lu設she計ji中zhong，要yao達da到dao這zhe兩liang個ge目mu的de已yi經jing越yue來lai越yue複fu雜za了le。在zai高gao速su數shu字zi電dian路lu係xi統tong中zhong
，信xin號hao完wan整zheng性xing問wen題ti變bian得de非fei常chang的de突tu出chu。一yi個ge非fei常chang重zhong要yao的de問wen題ti就jiu是shi電dian源yuan分fen配pei係xi統tong的de軌gui道dao塌ta陷xian（RailCollapse）。由於電源技術呈現出低電壓、開關電源開關頻率高頻化等一些不利於解決信號完整性的狀況，電源完整性被作為一個新的研究方向被提了出來。

通常電源完整性問題主要有兩個途徑來解決：優化電路板的層疊設計及布局布線和增加去耦電容。下麵主要介紹增加去耦電容的方法。

1去耦的原理

去qu耦ou電dian容rong就jiu像xiang是shi靠kao近jin需xu求qiu點dian的de能neng量liang存cun儲chu器qi一yi樣yang。通tong過guo在zai器qi件jian附fu近jin的de電dian源yuan和he地di之zhi間jian添tian加jia去qu耦ou電dian容rong
，可ke在zai快kuai速su突tu發fa周zhou期qi內nei來lai提ti供gong獨du立li於yu電dian源yuan的de能neng量liang，通tong過guo足zu夠gou的de儲chu量liang保bao證zheng所suo需xu要yao的de電dian壓ya對dui於yu一yi個ge給gei定ding的de電dian流liuI，紋波電壓或電壓降可以用公式（1）表述：

(1)
(2)
公式（2）說明了吸取電流導致的電壓降V。正如大多數的CMOS電路

，IC隻有在晶體管開關時才會汲取電流。這意味著當IC開kai關guan時shi就jiu汲ji取qu電dian流liu，會hui產chan生sheng一yi個ge電dian壓ya降jiang而er造zao成cheng電dian源yuan分fen布bu係xi統tong的de電dian源yuan紋wen波bo噪zao聲sheng。進jin一yi步bu看kan，隨sui著zhe處chu理li器qi速su度du的de增zeng加jia

，紋wen波bo噪zao聲sheng也ye會hui由you於yu更geng多duo的de邏luo輯ji狀zhuang態tai吸xi收shou電dian流liu而er相xiang應ying的de大da量liang增zeng加jia。

隨sui著zhe電dian路lu係xi統tong時shi鍾zhong頻pin率lv的de增zeng加jia，很hen多duo情qing況kuang就jiu不bu能neng按an照zhao理li想xiang的de電dian容rong器qi來lai考kao慮lv了le。一yi個ge實shi際ji的de電dian容rong不bu論lun是shi陶tao瓷ci電dian容rong還hai是shi電dian解jie電dian容rong，都dou可ke以yi被bei簡jian化hua成cheng一yi個ge串chuan聯lianRLC的模型。一個電容模型包括自身的電容C，還包括了等效的串聯電感ESL和等效串聯電阻ESR這兩個重要的參數。這個串聯模型的阻抗幅值是：

(3)
等效串聯電阻和等效串聯電感都是實際電容的寄生參數。
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電容的諧振頻率為：

(4)
在(zai)這(zhe)一(yi)諧(xie)振(zhen)頻(pin)率(lv)上(shang)，電(dian)容(rong)可(ke)達(da)到(dao)最(zui)小(xiao)的(de)阻(zu)抗(kang)。去(qu)耦(ou)就(jiu)是(shi)利(li)用(yong)電(dian)容(rong)在(zai)一(yi)定(ding)的(de)頻(pin)率(lv)範(fan)圍(wei)內(nei)，特(te)別(bie)是(shi)在(zai)諧(xie)振(zhen)頻(pin)率(lv)附(fu)近(jin)
，電(dian)容(rong)能(neng)夠(gou)對(dui)外(wai)呈(cheng)現(xian)一(yi)個(ge)較(jiao)低(di)的(de)阻(zu)抗(kang)（盡管可能是容性或者感性），為該頻率範圍內的噪聲在電源和地之間提供一個阻抗的通路



，從而確保IC電源的穩定。

現在讓我們定性的查看一下數字電源分布係統的ESL的效應。

(5)
(6)
公式（5）說明了電流I的變化會造成電源分布係統電壓V的下降。在大多數的CMOS電路中，IC在晶體管開關的時候汲取電流，這就意味著當IC開關，電流上就有一個變化，這就導致電源分布係統中的紋波。正如前所證明的，PDS中的紋波會造成係統的錯誤。要減少高頻下的這些錯誤
，就要盡可能的使用最低ESL的去耦電容。從公式（6）可以很明顯地看出來，ESL的減少會帶來電壓V的減小，即是紋波電壓的減小。

對於ESR來說也是同樣的，如果要更有效的對一個電源分布係統去耦，使用一個ESR盡可能小的電容會更有效果。為了便於說明，我們將實際的寄生電阻ESR寫到公式（2）中：

(7)
這就意味著不管電容怎樣增大
，ESR都會產生電壓降。在實際應用中

，我們必須增加電容值並減小ESR以盡可能的減小電源分布係統的紋波噪聲。同時，公式（2）和（7）表述了在高頻的情況下
，大電容不會對減少電壓降有太大的作用。反而
，公式（6）表明減小感抗比較增大電容有更明顯的效果。

2去耦電容的選擇

在低頻範圍（幾十MHz），電容呈現容性，高電容（並且有著低的ESR）將會有助於減少紋波噪聲。添加去耦電容可以在一個特定的頻率內減小紋波電壓：

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其中
，dt等於最慢的瞬態電流的上升時間（低頻）。假設有一個2A的瞬態電流
，電壓整流模塊會在15μs內響應。電源分布係統1.8V的電源供電電壓保持在5%的範圍內。需要的大電容估算是：
(9)
顯然，要找到333μF的陶瓷電容是並不容易的。設計者必須找到一個合適的電容
，對其進行並聯放置以達到所需要的電容和目標阻抗。添加電容的ESLbuzaiquouzhongqidaozhuyaodezuoyong，danshishejizhehaishiyinggaijinkenengxuanzebijiaoxiaodezhi
，zheyangnenggouzaibijiaokuandepinlvfanweineijianshaozukang。zheyangyouzhuyujianshaobanshangdequoudianrongdeshuliang。

在高頻（幾百MHz）範圍內，采用減少寄生電感的方式比提高電容值更有效一些。限製最大的電感量可以使紋波電壓達到最小：

(10)
其中，dt是瞬態電流的最快上升時間。假設一個2A的電流有著1ns的上升時間，電源分布係統保證1.8V電源供電5%以內的紋波。允許的電感量估算如下：


(11)
現在要找到一個ESL為45pH的表貼陶瓷電容還是比較困難的

，普通的表貼電容的寄生電感還是nH級的。反之來說，設計者要想達到這一電感量和目標阻抗，首先要選擇一個寄生電感足夠小的電容（在較高頻率的去耦方麵
，電容量的選擇並不起到首要的作用，但是假如給定了最低的ESL，我們必須選擇最高的可能容值。因為這樣能夠在較寬的頻率範圍內減小阻抗值）。足夠數量的低電感電容必須被並聯放置
，但是往往需要放置的電容比電路板空間所允許的更多。

3去耦電容的PCB設計

在印製電路板上，芯片-盤墊-走(zou)線(xian)所(suo)形(xing)成(cheng)的(de)環(huan)路(lu)電(dian)流(liu)所(suo)造(zao)成(cheng)的(de)電(dian)感(gan)則(ze)大(da)得(de)多(duo)。連(lian)接(jie)去(qu)耦(ou)電(dian)容(rong)到(dao)電(dian)源(yuan)軌(gui)道(dao)的(de)走(zou)線(xian)電(dian)感(gan)要(yao)比(bi)電(dian)容(rong)上(shang)的(de)寄(ji)生(sheng)電(dian)感(gan)明(ming)顯(xian)要(yao)大(da)。通(tong)常(chang)的(de)經(jing)驗(yan)數(shu)據(ju)是(shi)走(zou)線(xian)電(dian)感(gan)為(wei)10nH/in.。因此當其被安裝到這種高電感的安裝結構中，一個低電感電容的高頻去耦性能會顯著的降低。普通的表貼電容的ESL基本都是nH級的
，而走線、焊盤設計所帶來的寄生電感的增加要比電容自身的ESLmingxiandeduo。zaixianzaidegaopinquouyingyongzhong，zuixiaohuahuanludianganyeshizhiguanzhongyaode。yizhongzuixiaohuahuanludiangandefangshishijianshaohuanluquyudedaxiao。duibujulaishuo

，jiangdianyuanguidaozoudeyuejinyuehao
，shenzhishijiangdianyuanguidaozouzaiIC之zhi下xia，這zhe樣yang就jiu可ke以yi減jian少shao環huan路lu區qu域yu的de麵mian積ji。盡jin管guan如ru此ci
，對dui高gao頻pin去qu耦ou來lai說shuo，其qi性xing能neng還hai是shi會hui受shou限xian於yu走zou線xian和he電dian源yuan軌gui道dao的de電dian感gan。通tong過guo使shi用yong過guo孔kong在zai盤pan墊dian中zhong的de方fang式shi，環huan路lu電dian感gan還hai可ke以yi進jin一yi步bu的de降jiang低di。

zaizuiyoudepandianshejixia
，zhudaodiangandeshiguokonghedianrongdegaodu。guokongjiuxiangshiyigetianrandedianganxianquanyiyang。guokongdedianganzhizhengbiyuqichangduhezhijing。tongguoyigeguokong（8mil）穿過60mil的電路板連接一個去耦電容能夠增加1nH的(de)電(dian)感(gan)。此(ci)外(wai)
，電(dian)流(liu)傳(chuan)送(song)的(de)垂(chui)直(zhi)距(ju)離(li)會(hui)增(zeng)加(jia)環(huan)路(lu)的(de)大(da)小(xiao)從(cong)而(er)增(zeng)加(jia)電(dian)感(gan)量(liang)。最(zui)優(you)的(de)盤(pan)墊(dian)設(she)計(ji)和(he)最(zui)小(xiao)化(hua)電(dian)容(rong)頂(ding)部(bu)到(dao)電(dian)源(yuan)和(he)地(di)層(ceng)的(de)距(ju)離(li)，這(zhe)樣(yang)和(he)去(qu)耦(ou)電(dian)容(rong)相(xiang)關(guan)的(de)電(dian)感(gan)就(jiu)被(bei)減(jian)到(dao)最(zui)小(xiao)。

電源分布係統的低阻抗設計是保證電源係統穩定和係統電磁兼容性的重要因素。當然，電源分布係統設計問題並不止包括低阻抗設計、去耦電容這些問題，更有多電源層的排布、電源層麵的分割與隔離
，以及電源層麵的20H原則，等等。