電腦主機板上時鍾電路設計
發布時間:2010-11-04
中心議題:
所(suo)有(you)的(de)數(shu)字(zi)電(dian)路(lu)都(dou)需(xu)要(yao)依(yi)靠(kao)時(shi)鍾(zhong)信(xin)號(hao)來(lai)使(shi)組(zu)件(jian)的(de)運(yun)作(zuo)同(tong)步(bu),每(mei)單(dan)位(wei)時(shi)間(jian)內(nei)電(dian)路(lu)可(ke)運(yun)作(zuo)的(de)次(ci)數(shu)取(qu)決(jue)於(yu)時(shi)鍾(zhong)的(de)頻(pin)率(lv),因(yin)此(ci)時(shi)鍾(zhong)運(yun)作(zuo)的(de)頻(pin)率(lv)即(ji)被(bei)大(da)家(jia)視(shi)為(wei)係(xi)統(tong)運(yun)作(zuo)的(de)性(xing)能(neng)指(zhi)針(zhen)。
主機板時鍾電路的需求
---熟悉硬件的讀者應該都知道,主機板上處理器、芯片組和主存儲器等幾個主要的組件各有其工作時鍾,中央處理器CPU的外部頻率依照摩爾定律不斷提高,隨著英特爾與AMD在近期推出多款新的處理器,200MHz外頻的時代也正式來臨(CPU上標示的工作速度為處理器內頻,是以外頻乘以倍頻產生,並不由主機板時鍾電路直接提供)。處理器和北橋芯片之間以前端總線(FSB)相連接,以CPU的外頻為基準,每周期傳送兩次或四次數據,所以200MHz外頻乘上四倍頻就可以得到800MHz的FSB速度。內存也隨著CPU的腳步,工作頻率快速推進到200MHz的DDR400PC3200規格。其餘南橋芯片與AGP、PCI、USB等總線則各有其業界規定的工作時鍾標準,如PCI為33MHz、AGP為66MHz等等。
---因此主機板的時鍾電路必須為許多的組件提供各種不同的工作頻率,以往舊式的主機板都是使用石英振蕩器來lai處chu理li,但dan石shi英ying振zhen蕩dang器qi一yi次ci隻zhi能neng輸shu出chu一yi種zhong頻pin率lv,在zai需xu要yao多duo種zhong時shi鍾zhong輸shu出chu的de新xin式shi主zhu機ji板ban中zhong,顯xian然ran不bu敷fu使shi用yong。所suo以yi有you些xie廠chang商shang將jiang這zhe些xie原yuan本ben散san布bu在zai主zhu機ji板ban上shang各ge處chu的de振zhen蕩dang電dian路lu整zheng合he成cheng一yi顆ke可ke輸shu出chu各ge種zhong頻pin率lv的de芯xin片pian,主zhu機ji板ban采cai用yong此ci類lei時shi鍾zhong產chan生sheng芯xin片pian將jiang可ke以yi達da到dao節jie省sheng成cheng本ben與yu空kong間jian的de目mu的de。
時鍾發生器的基本構造
---鎖相環(PhaseLockedLoop,PLL)是時鍾發生器的核心技術,現代的時鍾發生器隻需由石英晶體提供一個基準頻率,並利用一個以上的PLL,搭配不同比例的除頻電路,來產生各種頻率的時鍾輸出,取代傳統係統中的多個石英晶體。時鍾發生器的基本架構如圖1所示。

---其中PLL的部分具有兩個輸入端,分別為參考頻率(Fref)與反饋頻率(Fvco),與一個輸出端(Fout)。三者之間關係可以公式表示如下。
Fout=(Fref•P)/(Q•N)
---PLL基(ji)本(ben)上(shang)為(wei)一(yi)個(ge)負(fu)反(fan)饋(kui)係(xi)統(tong),在(zai)回(hui)路(lu)中(zhong)利(li)用(yong)反(fan)饋(kui)信(xin)號(hao),將(jiang)輸(shu)出(chu)端(duan)的(de)信(xin)號(hao)頻(pin)率(lv)及(ji)相(xiang)位(wei),鎖(suo)定(ding)在(zai)輸(shu)入(ru)端(duan)參(can)考(kao)信(xin)號(hao)的(de)頻(pin)率(lv)及(ji)相(xiang)位(wei)上(shang)。相(xiang)位(wei)頻(pin)率(lv)檢(jian)波(bo)器(qi)(PhaseFrequencyDetector,PFD)比較基準參考頻率(Fref)及反饋頻率(Fvco)兩者之間的相位關係與頻率的差異,並檢知出兩者相位的相位差及頻率的高低差,以影響電壓控製振蕩器(VoltageControlledOscillator,VCO)的頻率輸出。當Fref/Q超前Fvco/P時,UP高電位輸出使Fout頻率加快;相反的當Fref/Q落後Fvco/P時,DN高電位輸出使Fout頻率減慢,最後可達到如公式所表示的穩定輸出狀態,因此隻需調整PLL外部除頻電路的P、Q、R值之間的比例,就可得到需要的輸出頻率。
PC超頻與時鍾電路的關聯
---chaopinduiyujisuanjifashaoyoulaishuo,keweishizuirezhongdeyigezhutile。suoweichaopinjiushiqiangpoxitongdegongzuoshizhongyugaoyubiaoshidepinlv,congerdadaotigaoxingnengdemude。
---基本的超頻方法即是藉由手動調整將中央處理器的工作頻率提高至標準的工作頻率之上,一般而言,生產中央處理器的廠商為了確保其CPU工作的穩定可靠,通常會以實際測試結果的較低規格來標示,使製造出來的計算機係統以低於CPU極限值的速度工作。因此使用者便有機會在不用付出額外成本的情形下,壓榨出係統的最佳效能。
---中央處理器的工作頻率等於外頻乘以倍頻數,不管是調整外頻或是倍頻數都可達到提高中央處理器工作頻率的目的,但目前大部分的CPU出廠時都已將倍頻死鎖固定,因此隻剩下外頻的部分可以由使用者動動手腳。
---以往調整外頻/倍頻的方法,需要使用者根據說明書調整主機板上的跳線或是DIP開關,以獲得想要的頻率。新一代的時鍾發生器,配備有SMBus(SystemManagementBus)接口,可由BIOSzhijiekongzhi,yincishiyongzheshenzhibuyongchaijike,zhixuzuozaijisuanjimianqian,tongguojianpanjipingmu,jikesuiyitiaozhengxitonggongzuopinlvle。ciwaitongguokongzhishizhongfashengqizhongdehuancunqikongzhiwei,keyiyijixiaodexianxingjijuweitiaoCPU的外頻(以MHz為單位),不像以往的跳線設定方式,一下子從100MHz直接跳至133MHz,CPU容易超出其極限而導致當機。
[page]
---ruqianshutidao,zhujibanshanggegezujiandouyouqigudingdegongzuopinlv,ergegezongxiandegongzuopinlvhexitongdepinlvdabufendouweichigudingdebililaigongzuo。huanjuhuashuo,chuantongdeshizhongfashengqitongchangshiyiCPU的外頻作為基準頻率,通過固定比例的除頻,產生其餘外設所使用的時鍾。所以當使用者調高CPU外頻的同時,總線及外設的時鍾也會等比例地被提升,有的時候CPU尚未超出其工作極限,反而是外設承受不了過高的頻率而罷工了。
---為了提高在超頻時的係統穩定性,新一代的時鍾發生器將AGP/PCI等總線的頻率,采用與CPU外頻“異步”的設計方式,或加入多段式的除頻子係統,使用者就可以自由設定AGP/PCI的工作頻率,以符合外設的工作需求。
---muqianshiyongruanjianlaitiaozhengchaopindepinlv,ruguopinlvshedingchaoguoxitongkejieshoudefanweishi,jisuanjigenbenjiuwufagongzuole,ruhejiangshedingtiaohuiyuanxiankeshiyongdezhuangtaine?CYPRESS為此在時鍾發生器中加入了稱為看門狗定時器(WatchdogTimer)的設計,每當BIOS為係統設定了新的工作頻率時,BIOS也要負責設定看門狗定時器的倒數計時時間。係統依新的工作頻率重新開機後,定時器依所設定的時間倒數,若係統正常啟動,則BIOS會負責通過SMBus將定時器設定清除,係統往後就依新的工作頻率運行;若(ruo)是(shi)係(xi)統(tong)無(wu)法(fa)正(zheng)常(chang)啟(qi)動(dong),當(dang)定(ding)時(shi)器(qi)倒(dao)數(shu)結(jie)束(shu)後(hou),時(shi)鍾(zhong)發(fa)生(sheng)器(qi)會(hui)發(fa)出(chu)複(fu)位(wei)信(xin)號(hao),使(shi)係(xi)統(tong)重(zhong)新(xin)啟(qi)動(dong),並(bing)將(jiang)時(shi)鍾(zhong)發(fa)生(sheng)器(qi)中(zhong)的(de)頻(pin)率(lv)設(she)定(ding)回(hui)複(fu)成(cheng)之(zhi)前(qian)可(ke)正(zheng)常(chang)工(gong)作(zuo)的(de)頻(pin)率(lv)設(she)定(ding)。因(yin)此(ci)當(dang)頻(pin)率(lv)設(she)定(ding)失(shi)敗(bai)時(shi),係(xi)統(tong)將(jiang)自(zi)動(dong)重(zhong)設(she)為(wei)原(yuan)始(shi)狀(zhuang)態(tai),使(shi)用(yong)者(zhe)無(wu)須(xu)介(jie)入(ru)以(yi)硬(ying)件(jian)重(zhong)設(she)係(xi)統(tong)。
時鍾發生器可簡化主機板設計
---專zhuan為wei主zhu機ji板ban設she計ji的de時shi鍾zhong發fa生sheng器qi,提ti供gong多duo種zhong的de可ke編bian程cheng特te性xing,方fang便bian主zhu機ji板ban廠chang商shang設she計ji產chan品pin。比bi如ru說shuo,對dui於yu使shi用yong者zhe超chao頻pin的de需xu求qiu,藉ji由you可ke編bian程cheng設she定ding的de時shi鍾zhong頻pin率lv,可ke由youBIOS中自由設定工作頻率,而不需要在主機板上多加額外的控製電路。
---kebianchengdeshizhongfashengqichulemanzuchaopindemudewai,qidongtaidepinlvtiaozhengnenglihaikeyiyongyujianshaodianyuanxiaohao。yibijibendiannaoweili,xitongzaiyunxingshibingbuzongshixuyaoquanbudechuliqixiaoneng,cishiketongguoshizhongdejiangdi,jianshaoxitongdegonglvxiaohao,yanchangdianchideshiyongshijian。
---lingwaiyushiyongzhejiaoweiwuguandeshizhongfashengqitexing,haibaokuokechengkongdeshizhiyudingshi,zhujibanchangshangkepeihegezhongbutongdejibanbuju,tiaozhenggezhongjiekoushizhongzhijiandeshizhongyanchi,shigezhongxiangguanjiekoudezujianbaochitongbu(或符合其相對的時鍾延遲規格)動作。並可依各類內存的不同特性,微調時鍾信號的觸發相位,以方便工程師進行電路板設計。
--主機板廠商也時常為了符合各種電磁幹擾(EMI)的法規而煩惱,產品通常必須重複進行送測、重布線、遮蔽隔離等耗費時間精力的程序,延後產品的上市時程,降低產品的獲利能力,目前時鍾發生器中的可編程擴頻(SST)功能則可用來降低產品的EMI。
---利用時鍾發生器中PLL的特性,以圖2所示的Lexmark曲線,以係統時鍾為中心作小幅度的調變,將可使EMI的能量平均散布在一小段的頻譜範圍中,以降低單一頻率EMI的峰值,如圖3所示。


---可編程的擴頻比例,可視主機板的線路不同布局,讓主機板工程師自行設定最符合該主機板設計的擴頻比例參數,調整出最好的EMI擴頻效果,也使工程師能在最短的時間內完成產品的開發。
---時鍾發生器與CPU一(yi)樣(yang),也(ye)隨(sui)著(zhe)時(shi)代(dai)的(de)腳(jiao)步(bu)逐(zhu)漸(jian)進(jin)化(hua)。目(mu)前(qian)時(shi)鍾(zhong)發(fa)生(sheng)器(qi)的(de)多(duo)功(gong)能(neng)與(yu)可(ke)編(bian)程(cheng)特(te)性(xing)讓(rang)使(shi)用(yong)者(zhe)在(zai)操(cao)作(zuo)上(shang)越(yue)來(lai)越(yue)便(bian)利(li),也(ye)使(shi)廠(chang)商(shang)在(zai)產(chan)品(pin)設(she)計(ji)上(shang)更(geng)加(jia)靈(ling)活(huo)。
- 時鍾發生器的基本構造
- 主機板時鍾電路的需求
- PC超頻與時鍾電路的關聯
- 鎖相環(PhaseLockedLoop,PLL)是時鍾發生器的核心技術
所(suo)有(you)的(de)數(shu)字(zi)電(dian)路(lu)都(dou)需(xu)要(yao)依(yi)靠(kao)時(shi)鍾(zhong)信(xin)號(hao)來(lai)使(shi)組(zu)件(jian)的(de)運(yun)作(zuo)同(tong)步(bu),每(mei)單(dan)位(wei)時(shi)間(jian)內(nei)電(dian)路(lu)可(ke)運(yun)作(zuo)的(de)次(ci)數(shu)取(qu)決(jue)於(yu)時(shi)鍾(zhong)的(de)頻(pin)率(lv),因(yin)此(ci)時(shi)鍾(zhong)運(yun)作(zuo)的(de)頻(pin)率(lv)即(ji)被(bei)大(da)家(jia)視(shi)為(wei)係(xi)統(tong)運(yun)作(zuo)的(de)性(xing)能(neng)指(zhi)針(zhen)。
主機板時鍾電路的需求
---熟悉硬件的讀者應該都知道,主機板上處理器、芯片組和主存儲器等幾個主要的組件各有其工作時鍾,中央處理器CPU的外部頻率依照摩爾定律不斷提高,隨著英特爾與AMD在近期推出多款新的處理器,200MHz外頻的時代也正式來臨(CPU上標示的工作速度為處理器內頻,是以外頻乘以倍頻產生,並不由主機板時鍾電路直接提供)。處理器和北橋芯片之間以前端總線(FSB)相連接,以CPU的外頻為基準,每周期傳送兩次或四次數據,所以200MHz外頻乘上四倍頻就可以得到800MHz的FSB速度。內存也隨著CPU的腳步,工作頻率快速推進到200MHz的DDR400PC3200規格。其餘南橋芯片與AGP、PCI、USB等總線則各有其業界規定的工作時鍾標準,如PCI為33MHz、AGP為66MHz等等。
---因此主機板的時鍾電路必須為許多的組件提供各種不同的工作頻率,以往舊式的主機板都是使用石英振蕩器來lai處chu理li,但dan石shi英ying振zhen蕩dang器qi一yi次ci隻zhi能neng輸shu出chu一yi種zhong頻pin率lv,在zai需xu要yao多duo種zhong時shi鍾zhong輸shu出chu的de新xin式shi主zhu機ji板ban中zhong,顯xian然ran不bu敷fu使shi用yong。所suo以yi有you些xie廠chang商shang將jiang這zhe些xie原yuan本ben散san布bu在zai主zhu機ji板ban上shang各ge處chu的de振zhen蕩dang電dian路lu整zheng合he成cheng一yi顆ke可ke輸shu出chu各ge種zhong頻pin率lv的de芯xin片pian,主zhu機ji板ban采cai用yong此ci類lei時shi鍾zhong產chan生sheng芯xin片pian將jiang可ke以yi達da到dao節jie省sheng成cheng本ben與yu空kong間jian的de目mu的de。
時鍾發生器的基本構造
---鎖相環(PhaseLockedLoop,PLL)是時鍾發生器的核心技術,現代的時鍾發生器隻需由石英晶體提供一個基準頻率,並利用一個以上的PLL,搭配不同比例的除頻電路,來產生各種頻率的時鍾輸出,取代傳統係統中的多個石英晶體。時鍾發生器的基本架構如圖1所示。

---其中PLL的部分具有兩個輸入端,分別為參考頻率(Fref)與反饋頻率(Fvco),與一個輸出端(Fout)。三者之間關係可以公式表示如下。
Fout=(Fref•P)/(Q•N)
---PLL基(ji)本(ben)上(shang)為(wei)一(yi)個(ge)負(fu)反(fan)饋(kui)係(xi)統(tong),在(zai)回(hui)路(lu)中(zhong)利(li)用(yong)反(fan)饋(kui)信(xin)號(hao),將(jiang)輸(shu)出(chu)端(duan)的(de)信(xin)號(hao)頻(pin)率(lv)及(ji)相(xiang)位(wei),鎖(suo)定(ding)在(zai)輸(shu)入(ru)端(duan)參(can)考(kao)信(xin)號(hao)的(de)頻(pin)率(lv)及(ji)相(xiang)位(wei)上(shang)。相(xiang)位(wei)頻(pin)率(lv)檢(jian)波(bo)器(qi)(PhaseFrequencyDetector,PFD)比較基準參考頻率(Fref)及反饋頻率(Fvco)兩者之間的相位關係與頻率的差異,並檢知出兩者相位的相位差及頻率的高低差,以影響電壓控製振蕩器(VoltageControlledOscillator,VCO)的頻率輸出。當Fref/Q超前Fvco/P時,UP高電位輸出使Fout頻率加快;相反的當Fref/Q落後Fvco/P時,DN高電位輸出使Fout頻率減慢,最後可達到如公式所表示的穩定輸出狀態,因此隻需調整PLL外部除頻電路的P、Q、R值之間的比例,就可得到需要的輸出頻率。
PC超頻與時鍾電路的關聯
---chaopinduiyujisuanjifashaoyoulaishuo,keweishizuirezhongdeyigezhutile。suoweichaopinjiushiqiangpoxitongdegongzuoshizhongyugaoyubiaoshidepinlv,congerdadaotigaoxingnengdemude。
---基本的超頻方法即是藉由手動調整將中央處理器的工作頻率提高至標準的工作頻率之上,一般而言,生產中央處理器的廠商為了確保其CPU工作的穩定可靠,通常會以實際測試結果的較低規格來標示,使製造出來的計算機係統以低於CPU極限值的速度工作。因此使用者便有機會在不用付出額外成本的情形下,壓榨出係統的最佳效能。
---中央處理器的工作頻率等於外頻乘以倍頻數,不管是調整外頻或是倍頻數都可達到提高中央處理器工作頻率的目的,但目前大部分的CPU出廠時都已將倍頻死鎖固定,因此隻剩下外頻的部分可以由使用者動動手腳。
---以往調整外頻/倍頻的方法,需要使用者根據說明書調整主機板上的跳線或是DIP開關,以獲得想要的頻率。新一代的時鍾發生器,配備有SMBus(SystemManagementBus)接口,可由BIOSzhijiekongzhi,yincishiyongzheshenzhibuyongchaijike,zhixuzuozaijisuanjimianqian,tongguojianpanjipingmu,jikesuiyitiaozhengxitonggongzuopinlvle。ciwaitongguokongzhishizhongfashengqizhongdehuancunqikongzhiwei,keyiyijixiaodexianxingjijuweitiaoCPU的外頻(以MHz為單位),不像以往的跳線設定方式,一下子從100MHz直接跳至133MHz,CPU容易超出其極限而導致當機。
[page]
---ruqianshutidao,zhujibanshanggegezujiandouyouqigudingdegongzuopinlv,ergegezongxiandegongzuopinlvhexitongdepinlvdabufendouweichigudingdebililaigongzuo。huanjuhuashuo,chuantongdeshizhongfashengqitongchangshiyiCPU的外頻作為基準頻率,通過固定比例的除頻,產生其餘外設所使用的時鍾。所以當使用者調高CPU外頻的同時,總線及外設的時鍾也會等比例地被提升,有的時候CPU尚未超出其工作極限,反而是外設承受不了過高的頻率而罷工了。
---為了提高在超頻時的係統穩定性,新一代的時鍾發生器將AGP/PCI等總線的頻率,采用與CPU外頻“異步”的設計方式,或加入多段式的除頻子係統,使用者就可以自由設定AGP/PCI的工作頻率,以符合外設的工作需求。
---muqianshiyongruanjianlaitiaozhengchaopindepinlv,ruguopinlvshedingchaoguoxitongkejieshoudefanweishi,jisuanjigenbenjiuwufagongzuole,ruhejiangshedingtiaohuiyuanxiankeshiyongdezhuangtaine?CYPRESS為此在時鍾發生器中加入了稱為看門狗定時器(WatchdogTimer)的設計,每當BIOS為係統設定了新的工作頻率時,BIOS也要負責設定看門狗定時器的倒數計時時間。係統依新的工作頻率重新開機後,定時器依所設定的時間倒數,若係統正常啟動,則BIOS會負責通過SMBus將定時器設定清除,係統往後就依新的工作頻率運行;若(ruo)是(shi)係(xi)統(tong)無(wu)法(fa)正(zheng)常(chang)啟(qi)動(dong),當(dang)定(ding)時(shi)器(qi)倒(dao)數(shu)結(jie)束(shu)後(hou),時(shi)鍾(zhong)發(fa)生(sheng)器(qi)會(hui)發(fa)出(chu)複(fu)位(wei)信(xin)號(hao),使(shi)係(xi)統(tong)重(zhong)新(xin)啟(qi)動(dong),並(bing)將(jiang)時(shi)鍾(zhong)發(fa)生(sheng)器(qi)中(zhong)的(de)頻(pin)率(lv)設(she)定(ding)回(hui)複(fu)成(cheng)之(zhi)前(qian)可(ke)正(zheng)常(chang)工(gong)作(zuo)的(de)頻(pin)率(lv)設(she)定(ding)。因(yin)此(ci)當(dang)頻(pin)率(lv)設(she)定(ding)失(shi)敗(bai)時(shi),係(xi)統(tong)將(jiang)自(zi)動(dong)重(zhong)設(she)為(wei)原(yuan)始(shi)狀(zhuang)態(tai),使(shi)用(yong)者(zhe)無(wu)須(xu)介(jie)入(ru)以(yi)硬(ying)件(jian)重(zhong)設(she)係(xi)統(tong)。
時鍾發生器可簡化主機板設計
---專zhuan為wei主zhu機ji板ban設she計ji的de時shi鍾zhong發fa生sheng器qi,提ti供gong多duo種zhong的de可ke編bian程cheng特te性xing,方fang便bian主zhu機ji板ban廠chang商shang設she計ji產chan品pin。比bi如ru說shuo,對dui於yu使shi用yong者zhe超chao頻pin的de需xu求qiu,藉ji由you可ke編bian程cheng設she定ding的de時shi鍾zhong頻pin率lv,可ke由youBIOS中自由設定工作頻率,而不需要在主機板上多加額外的控製電路。
---kebianchengdeshizhongfashengqichulemanzuchaopindemudewai,qidongtaidepinlvtiaozhengnenglihaikeyiyongyujianshaodianyuanxiaohao。yibijibendiannaoweili,xitongzaiyunxingshibingbuzongshixuyaoquanbudechuliqixiaoneng,cishiketongguoshizhongdejiangdi,jianshaoxitongdegonglvxiaohao,yanchangdianchideshiyongshijian。
---lingwaiyushiyongzhejiaoweiwuguandeshizhongfashengqitexing,haibaokuokechengkongdeshizhiyudingshi,zhujibanchangshangkepeihegezhongbutongdejibanbuju,tiaozhenggezhongjiekoushizhongzhijiandeshizhongyanchi,shigezhongxiangguanjiekoudezujianbaochitongbu(或符合其相對的時鍾延遲規格)動作。並可依各類內存的不同特性,微調時鍾信號的觸發相位,以方便工程師進行電路板設計。
--主機板廠商也時常為了符合各種電磁幹擾(EMI)的法規而煩惱,產品通常必須重複進行送測、重布線、遮蔽隔離等耗費時間精力的程序,延後產品的上市時程,降低產品的獲利能力,目前時鍾發生器中的可編程擴頻(SST)功能則可用來降低產品的EMI。
---利用時鍾發生器中PLL的特性,以圖2所示的Lexmark曲線,以係統時鍾為中心作小幅度的調變,將可使EMI的能量平均散布在一小段的頻譜範圍中,以降低單一頻率EMI的峰值,如圖3所示。


---可編程的擴頻比例,可視主機板的線路不同布局,讓主機板工程師自行設定最符合該主機板設計的擴頻比例參數,調整出最好的EMI擴頻效果,也使工程師能在最短的時間內完成產品的開發。
---時鍾發生器與CPU一(yi)樣(yang),也(ye)隨(sui)著(zhe)時(shi)代(dai)的(de)腳(jiao)步(bu)逐(zhu)漸(jian)進(jin)化(hua)。目(mu)前(qian)時(shi)鍾(zhong)發(fa)生(sheng)器(qi)的(de)多(duo)功(gong)能(neng)與(yu)可(ke)編(bian)程(cheng)特(te)性(xing)讓(rang)使(shi)用(yong)者(zhe)在(zai)操(cao)作(zuo)上(shang)越(yue)來(lai)越(yue)便(bian)利(li),也(ye)使(shi)廠(chang)商(shang)在(zai)產(chan)品(pin)設(she)計(ji)上(shang)更(geng)加(jia)靈(ling)活(huo)。
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